FPGA可编程逻辑器件芯片XC6SLX9-2FT

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摘要:DieLevelBankNumberingandClockPinsOverviewFigure1-1throughFigure1-11visuallydescribeadieviewoftheFPGAbanknumbering.Table1-7showstheI/Obanknamesandlocations.Notallbanksarebondedoutineverypart/packagecombination.Table1-7:Virtex-6FPGABankNumberingBankNameLocationDescriptionIOCLI/Ocenter,leftbankcolumnAvailableineverydevice.IOCRI/Ocenter,rightbankcolumnAvailableineverydevice.IOOLI/Oouter,leftbankcolumnOnlyavailableinallLX,LXT,andSXTdevices.IOORI/Oouter,rightbankcolumnDevicedependent,forLX,LXT,andSXTdevicesonly.Bank0•ThecentercolumncontainsBank0.•Bank0containsdedicatedconfigurationpins.•Bank0isfilledwithCLB_LLsonthetopandbottom.•TheCMT(MMCM)columnisadjacenttotheright.HorizontalClockRow

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